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　　广义而言，可编程ASIC 芯片可分为FPGA 芯片和PLD 芯片。在实际生产过程中，将FPGA 芯片列为不同于ASIC  芯片的研究机构和企业数量不断增加，故本报告仅将PLD(Programmable Logic Device)视为可编程ASIC 芯片子类别。PLD 亦称可编程逻辑器件，在结构上包括基础逻辑单元矩阵、触发器、锁存器等，其互连部分作为单个模块存在。设计人员通过对PLD  进行编程以满足部分定制应用程序需求。

　　早期CPU的前端总线频率是与CPU的外频同步的。随着CPU工作能力的加强（主频越来越高），原来的那种低频率前端总线已经满足不了CPU的需要，于是人们开始在“前端总线频率”上做起了文章——在不提高系统总线基准频率的前体下，将前端总线单个时钟周期能够传输的数据个数以“倍数”增加。以当前的Pentium 4系列CPU为例，Intel为它设计了一个名为“Quad-pumped”的前端总线，其实质就是该前端总线在一个时钟周期内，可以传输4倍的数据。早期的Pentium 4的外频都是100MHz，而由于采用了“Quad-pumped”技术，这类CPU的前端总线频率便成了“100MHz×4=400MHz”。如今，Pentium 4的前端总线已经达到了800MHz，但其实际的外频是200MHz。

　　集成电路对于离散晶体管有两个主要优势:成本和性能。成本低是由于芯片把所有的组件通过照相平版技术，作为一个单位印刷，而不是在一个时间只制作一个晶体管。性能高是由于组件快速开关，消耗更低能量，因为组件很小且彼此靠近。2006年，芯片面积从几平方毫米到350 mm²，每mm²可以达到一百万个晶体管。

　　输出电流大时应采用降压式DC/DC变换器便携式电子产品大部分工作电流在300mA以下，并且大部分采用5#镍镉、镍氢电池，若采用1～2节电池，升压到3.3V或5V并要求输出500mA以上电流时，电池寿命不长或两次充电间隔时间太短，使用不便。这时采用降压式DC/DC变换器，其效率与升压式差不多，但电池的寿命或充电间隔时间要长得多。采用LDO的佳条件当要求输出电压中纹波、噪声小的场合，输入输出电压差不大，输出电流不大于100mA时采用微功耗、低压差（LDO）线性稳压器是合适的。